作者AdonisLam (Adonis)
看板Grad-ProbAsk
標題[理工] 計組 pipeline
時間Fri Nov 29 16:49:33 2019
如附圖
第一題的cycle time是那些元件的時間
http://i.imgur.com/6U51xzF.jpg
http://i.imgur.com/707p05A.jpg
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1F：推 zuchang: 所以你的問題是什麼 = = 11/29 17:02
2F：→ AdonisLam: 我是問他寫的時間是哪些元件的延遲時間 11/29 23:46
3F：→ AdonisLam: 因為他只有寫數字 11/29 23:46
4F：推 zuchang: IF:15+50(pc+mem 11/30 13:04
5F：→ zuchang: ID:15+20+10(control+mux 11/30 13:04
6F：→ zuchang: EXE:15+20+10+30(mux+alu+forwarding 11/30 13:04
7F：→ zuchang: MEM:15+50 11/30 13:04
8F：→ zuchang: WB:15+10+20 除了IF之外都要加上pipeline register 11/30 13:04