作者proach (p.roach)
看板Electronics
標題Re: [問題] trigger flip-flop問題
時間Tue May 5 02:08:07 2009
※ 引述《pupucar (knock!knock!)》之銘言：
: 我們知道一個posedge trigger的D-FF
: 當clock由low to high時就會simple D的值
: 想請問的是萬一clock是由3-state to high呢?
: 是否有可能造成錯誤的trigger?? 謝謝!
其實這是個不是問題的問題 :)
由hi-z轉為high的過程是不確定的，所以有可能造成問題，但是，
在 hi-z之前呢？你讓clock pin保持在不確定嗎？所以要出問題早就
出問題了，不必考慮轉態的過程是否出問題。
最簡單的方法，將clock pin裝上pull-high or pull-low resistor，
讓他不會有不確定的時候。
good luck :)
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◆ From: 118.160.67.89
1F：推 pupucar:我懂了 謝謝! 05/05 03:09