作者SiriusJinn (假斯汀)
看板Electronics
標題[問題] modelsim模擬問題
時間Sun Nov 2 01:40:43 2008
剛隨便找了個別人打好的verilog檔
用modelsim讀進去
compiler成功
但simulation失敗
想知道問題出在哪
# Compile of c432.v was successful.
Modelsim> vsim work.c432
# vsim work.c432
# ** Note: (vsim-3812) Design is being optimized...
# ** Error: C:/c432.v(31): Module 'inv_1' is not defined.
# ** Error: C:/c432.v(32): Module 'inv_1' is not defined.
# ** Error: C:/c432.v(33): Module 'inv_1' is not defined.
# ** Error: C:/c432.v(34): Module 'inv_1' is not defined.
.
.
.(太多了省略一些)
.
.
# ** Error: C:/c432.v(187): Module 'nand4_1' is not defined.
# ** Error: C:/c432.v(188): Module 'nand4_1' is not defined.
# ** Error: C:/c432.v(189): Module 'nand4_1' is not defined.
# ** Error: C:/c432.v(190): Module 'nand4_1' is not defined.
# Optimization failed
# Error loading design
總覺得是少了點東西
是沒有給它 cell library 嗎？
順便問一下將 sdf 檔一起載入的話
波形會有差嗎？
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◆ From: 211.74.242.205
1F：推 arclitetank:1.對 2.是 11/02 01:42
2F：→ SiriusJinn:那這些東西可以自已定義嗎？還是一定要拿到0.18的資料 11/02 01:46
3F：→ sasako:應該是沒有把module一起丟進去做compile.. 11/02 01:52
4F：→ sasako:而且他已經跟你說第幾行有問題 就去check一下囉.. 11/02 01:52
5F：→ SiriusJinn:module是製程資料吧？error幾乎是從頭錯到尾.... 11/02 02:03
6F：推 zxvc:你的c432.v有去call inv_1、nand4_1這些modules，但ModelSim 11/02 07:16
7F：→ zxvc:找不到。另外compiler是名詞、compile是動詞。 11/02 07:18