作者BruceBowen12 (just defense)
看板Electronics
標題[問題] layout
時間Fri Aug 3 12:18:55 2007
各位前輩好
在做drc時出現以下的這個問題
T.3P { @ N-well pickup OD to PMOS space > 30um
NWELi_US = SIZE NWELi BY - 0.085 // 0.12/1.415 = 0.085
// 30/1.415 = 21.201, (0.6 + 2 * 0.085)/1.415 = 0.544
NTAP_OS = SIZE NTAP BY 21.201 INSIDE OF NWELi_US STEP 0.544 TRUNCATE 0.544
PASD_FAR = PASD NOT NTAP_OS
PASD_FAR_FILTER = SIZE PASD_FAR BY 30
NTAP_NEAR = NTAP INTERACT PASD_FAR_FILTER
// doing an more accurate sizing
NTAP_NEAR_OS = SIZE NTAP_NEAR BY 0.10
NTAP_90_CORNER = INT NTAP_NEAR_OS < 0.06 ABUT==90 INTERSECTING ONLY REGION
NTAP_OCT = NTAP_NEAR_OS NOT NTAP_90_CORNER
NTAP_135_CORNER = INT NTAP_OCT < 0.04 ABUT>134<136 INTERSECTING ONLY REGION
NTAP_HEX = NTAP_OCT NOT NTAP_135_CORNER
// 30-0.10 = 29.9
NTAP_HEX_OS = SIZE NTAP_HEX BY 29.9 INSIDE OF NWELi_US STEP 0.544 TRUNCATE 0.544
PASD_FAR NOT NTAP_HEX_OS
}
導致在做lvs時
找不到pmos body的電壓
找了半天 不知道是那裡出錯了
我是用laker去畫的
兩個pmos的共用端 我是用疊起來的
外面在畫nwell
pmos是直接拿內建的
希望高手大大能幫忙一下小弟>"<
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◆ From: 140.123.112.130
1F：推 BuBuChen:他不是告訴你pick-up>30um嗎?我猜你well裡沒加pick-up 08/03 13:08
2F：推 BruceBowen12:pick-up 是什麼呀?我還真的都沒用耶 08/03 13:53
3F：推 points333:你沒畫VDD吧 VDD的OD到PMOS的OD 要在30um之內 08/03 21:48
4F：推 ilovecatch:nwell 沒包到 body 08/03 23:24
5F：推 BuBuChen:n-well要打contact接到vdd 08/04 00:48
6F：推 BruceBowen12:我是直接從pmos拉線接到vdd的 應該是不用打contact 08/06 13:32
7F：→ BruceBowen12:而且我nwell把pmos全包起來了vdd和gnd也都在30um內 08/06 13:34
8F：→ BruceBowen12:請問這到底是什麼原因 08/06 13:36
9F：推 coa481:如果你body是用guard_ring來拉，那就代表你的body離MOS太遠 08/06 18:25
10F：→ coa481:想辦法在其他地方畫guard_ring，再用metal接起來即可 08/06 18:26
11F：→ coa481:pick-up其實就是指body 08/06 18:27
12F：推 BruceBowen12:我也沒有畫body 我laker真接拿內建好的 body還需要另 08/07 05:20
13F：→ BruceBowen12:外畫嗎? guard_ring是怎麼用的呢? 之前畫也全用內建 08/07 05:21
14F：→ BruceBowen12:的 都還可以用>"< 08/07 05:22
15F：推 usefun:我是加整排contact、vdd相接，蟋M後n-well把整個pmos包起來 08/07 10:17