我好像快要可以毕业了.... 很多因素，不完全是我的东西都做完了... 因为老板 6/20 要出国,七月多才回来~而我很可能七月中就要去当兵~ 他本来说那我们七月口试好了，我一听心都凉掉了~ 就只好乱凹一些有的没的，所以老板也同意六月中口试~ 其实我的东西还没有做完... 我的论文是 FPGA 跟 DSP 的合作运算~ 主要的名堂在 FPGA 上，我要用 FPGA 算出通道系数，然後送到 DSP 上做运算~ DSP 上的运算很单纯，只是量很大，其实没什麽东西好讲~ 主要就是在通道系数的产生... 这个部分我已经做的差不多了，但是我的 DSP 板子送修去，一直没有回来... 说真的，就算回来以後，要把通道系数从 FPGA 上送到 DSP 上也是工程一件... 那是技术性的问题，并没有什麽学术上的价值~ 总之,我就决定以通道系数产生器来毕业了... 觉得很心虚，因为我的东西没有全部做完...:~~~ 老师问我，你做这个东西有没有什麽突破或者贡献? 我也是很心虚的掰了一些出来.... 最後就是老师也半信半疑的同意用这样的东西六月中毕业.. 可是我真的很心虚啊... 实在是没有什麽贡献或突破.... 哎呀.... 这就是我读了两年研究所的成果啊..:~~~~ 总之，论文先写完，走一步算一步... --

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