作者tony810903 (wowhaha)
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标题[简单问题] VHDL的D正反器 负缘触发问题
时间Wed Feb 11 09:06:31 2009
小弟初学VHDL 要写一个负缘触发的D正反器
程式码没有错误
在写完要模拟波形的时候遇到问题
波形图如下:
clk ￣__￣__￣__￣
D ￣____￣￣____
Q __￣￣____￣￣
其中上面的线代表1
而下面的线代表0
想问各位大大
这题是负缘触发
为什麽当
clk从1变成0时(负缘触发)
但是Q却没有将D的值输入过来
D正反器不是在触发时 会让Q=D吗?
但是为什麽Q的结果在负缘触发时会反向呢?
在正缘触发却没问题
谢谢大大们的回答
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※ 编辑: tony810903 来自: 123.193.239.212 (02/11 09:08)
1F：推 NAMESTANLY:你D设的不好~ 别跟CLK同时变化 140.130.175.96 02/12 11:30