作者acelp (未来，一直来一直来)
看板Electronics
标题Re: [问题] 请问有ARM+FPGA实验板而不是扩充的？
时间Fri Dec 28 00:33:26 2007
我的疑问就在於 用高阶的产品virtex4以上 LX80以上一颗都多大颗
里头的数位逻辑怎麽可能多简单
好吧 就算有硬体乘法器又怎样...
10 tap FIR 用10bit的准确度合成 clock rate我相信硬生生就被压下去了
几百M? 能跑个100多M都偷笑了
我也不知道一颗65nm的FPGA强调他IO有多快是有什麽意义?
真的有人用高阶的FPGA IO需要跑到这麽高的clock rate?
※ 引述《motor447 (motor447)》之铭言：
: 高阶的产品都内含硬体乘法器,
: 有的还有硬体的 Gigabit Ethernet MAC, 硬体 PLL,
: 400MHz 以上不是问题!
: 数位逻辑只要跑 io 的 1/8 或 1/32 即可,
: io 区块都有内含 SerDes,
: 介面是 io speed 的 1/8 或 1/32
: ※ 引述《acelp (未来，一直来一直来)》之铭言：
: : 想io这麽快大概都是高阶的产品吧? 可是高阶产品数位逻辑可以跑上1G吗?
: : 来几个加法乘法能上一百多M就差不多了
: : 看多一些产品FPGA跑不太动都降速在跑
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◆ From: 220.133.134.198
1F：推 MasterChang:射频都到GHz... 12/28 02:37
2F：→ acelp:RF front end都会降到IF IF大概都低於100M了... 12/28 08:46
3F：推 pow:有在开发RAM或者其他I/O电路的人（用到SerDes） 12/28 21:20
4F：→ pow:会用到RocketIO 12/28 21:21
5F：推 pow:这里的RocketIO就是Vertex里面IO block的名称 12/28 21:25
6F：→ pow:我记得Vertex3跟5里面的RocketIO速度好像是一样快 12/28 21:26
7F：→ pow:差别是power不一样 .13跟65nm的差别 12/28 21:26
8F：→ pow:事实上我觉得IO速度再快都会有人用到 12/28 21:27
9F：→ pow:不过我有听说Xilinx的manual很难读 乱写一通 12/28 21:28
10F：→ pow:我个人只有看过RocketIO的部分 的确是乱写一通 12/28 21:28
11F：→ pow:大学的报告如果写成那样一定只能拿30分 12/28 21:29
12F：→ motor447:没有virtex-3这种东西,只有virtex-2/4/5 12/30 18:37