課名：積體電路設計實驗 IC LAB 科號：EE429200 老師：黃朝宗 課本：無 課別：電機系專業選修 學分：3 涼度： 甜度：★★★ 建議先修課程： 積體電路設計導論 邏輯設計 邏輯設計實驗 課程內容\簡介： 課程主要分三大章節 前兩部分屬於Front-end design。 1. RTL design 老師有印Cadence的教學講義給同學， 上課就是根據這個來上。 老師會對Sumulation機制、Coding style、Code對應的電路作介紹。 這邊好好聽可以糾正很多觀念。 2. Synthesis 老師會對合成的指令和機制作觀念上的介紹 因為時間不多沒有講到非常深入。 其中我覺得最有趣的是不要想那麼多設計技巧，用最簡單的寫法，tool會幫你處理好。 老師還做了Design Space Exploration的圖來解釋把課本的特殊電路刻出來， 還是贏不了tool的優化XD 3. Place & Rounte APR的back-end design就比較艱澀一點。 老師從Floor plan、Power plan、Placement、CTS、Routing都有觀念上的介紹。 但我覺得實際要瞭解還是上機寫一次LAB最快。 這門課如課綱所說，會從前段帶到後段，如果好好寫作業和上課認真聽， 對IC設計的背景知識和技術真的會精進不少。 上課方式： (板書?powerpoint?實地參訪?小組討論?) PPT 考試作業型態： 1. 12次LAB 每次LAB都會跟上課進度有所關聯， 通常是週四deadline的前一個周三公布 但很多人都周三公布 週四馬上DEMO真的厲害XD 中間的LAB難度蠻高的，沒有經驗的人會花不少時間QQ 2. 5次作業 (1) Three-input Raster Operations (ROP3) for ComputerGraphics 算是熱身的作業，主要在寫MUX來輸出各種邏輯運算，還有實作演算法優化後的公式解 (2) Enigma (不用合成) 實作二戰德軍的加解碼器，這邊算是第一個演算法實作的作業。 (3) Enigma (需合成) 因為作業二不需要合成，亂寫的電路也可以動，但這一次作業需要壓面積跟頻率。 這一次作業可以算是第一次邁入真正的design，需要想要怎麼切pipeline。 還要在切pipeline時壓面積，不然會過不了PPA。 此外助教還有開放天梯，PPA前兩名的有加分。 (4) QR Code Decoder 痛苦，非常痛苦，無比痛苦QQ 超複雜演算法，還要跨Field的運算。 我總共花了60小時，PPA才Class B.... (5) Digit classificationusing CNN 最後一個作業比較簡單，在寫影像辨識的CNN。 我大概花30小時，PPA勉強過Class A。 上述作業真的都可以拿來應用，譬如作業4，你拿一張QR code，上面亂畫黑點弄髒， 如果電路功能有作對，真的可以解碼出網址。這些作業寫完真的有種莫名的成就感XD 但作業四跟五剛好是在期中考週，那陣子每天起床就是打code，真的好累... 3. Final Project 大家要先開好Propossal，老師會根據你的難度給一個class，然後每種class的分數有上限。 分兩次DEMO，第一次是Front-end DEMO，要做完合成並上台報告。 第二次是Back-end DEMO，要做完整個APR flow，並上台報告整體結果 包含怎麼設計、驗證、遇到的困難、效能 等等... (數量的多寡、還是繳交報告?) 老師的喜好、個性： 老師是業界工程師回到學界，有一種莫名的宅宅工程師感(? (與同學相處融洽?還是嚴禁遲到?) 給加簽嗎? 加簽有優先順序 1. 電機大四 2. 雙主輔電機的大四 3. 電資院大四 4. 電機系相關碩班 補充: 這門課不愧是清大電機最硬的實驗課。 真的硬到差點二退，尤其期中考時還炸一堆作業 不過修完真的對IC設計有更深入的了解，Verilog也不再寫得那麼像C了(? 如果對數位IC有興趣或是對$$有興趣的人真的可以修 BTW 發哥最近徵人薪水開到200，快追上Google的HWE了... 總成績/班上排名： 成績: 成績分布： ↓每組人數 A+ % ( ) A % ( ) A- % ( ) B+ % ( ) B % ( ) B- % ( ) C+ % ( ) C % ( ) C- % ( ) D以下 % ( ) --

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