課名：邏輯設計 科號：EECS101002 老師：馬席彬 課本：M. Morris R. Mano and Michael D. Ciletti, Digital Design 課別：電機系必修 學分：3 涼度：★★(滿分五分，空心代表半分!請自行增減!) 甜度：★★★ 建議先修課程：無 課程內容\簡介： (1)Digital systems and information 進位介紹跟編碼介紹 (2)Combinational logic circuits 布林代數、邏輯閘介紹 (3)Combinational logic design 介紹Verilog 跟 Vivado K-map、真值表、組合邏輯電路 PI/EPI NAND/NOR (4)Arithmetic functions Adder、Multiplier、Decoder、Encoder、Comparator、Shifter (5)Sequential circuits Latch、Flip-Flop、Finite-State-Machine (6)Registers and register transfers Shift-Register、Register (7)Memory basics 介紹RAM、ROM跟FPGA 上課方式： 用PPT上課，偶爾搭配板書，大部分人有把PPT列印下來，剩下就是用電腦 或是平板。講課速度適中，但是聲音催眠，上課都會有不少人倒下，老師 每堂課都會複習之前上過的課程。 給分： Homeworks and quiz 25% Midterm Exams x2 50% Final Exam 25% 考試作業型態： 作業有6次還是7次的樣子，大部分都是手寫 有一兩次作業是用Vivado跑verilog的波形圖 期中和期末的範圍就是作業的範圍 考試難度算是中間偏難，通常是作業的變型題 最後兩次考試有比較生活化的題目，通常會很 花時間，大家也比較拿不到分數。 老師的喜好、個性： 上課認真，但是聲音非常催眠。不喜歡同學分心做其他事情 給加簽嗎? 給，但是優先給電機系大一 補充: 作業用心寫，應該會有還不錯的成績 總成績/班上排名： 成績: A+ 1/138 成績分布： https://imgur.com/JDKMWCS --

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