作者jo4fu3p (文字皆為筆畫(刂))
看板NCTU-Teacher
標題[心得] 蔡文錦 - 計算機組織
時間Fri Jun 30 21:28:49 2017
⊕課名⊕
計算機組織
▲教授▲
蔡文錦
★修課年度★
105下 資工系
£教了什麼£(課程大概內容。或是額外學會了什麼東西。)
Chapter 1 Computer Abstractions and Technology
Chapter 2 Instructions Language of the Computer
Chapter 3 Arithmetic for Computers
Chapter 4 The Processor
Chapter 5 Large and Fast Exploiting Memory Hierarchy
Chapter 6 Parallel Processor
◆上課方式◆(投影片、團體討論、老師教學風格)
講解投影片
講得算清楚,不過講的速度有點快,可能一恍神回來就跟不上了
講到一個段落會問大家有沒有問題,只不過都沒有人發問0.0
▼考試作業▼
三次大考 各佔20% 共60%
六次作業 總共20%
五次小考 總共20%
最後的計分方法:
三次大考各20%加起來變60%,再依40%, 35%, 25%的比例去分配這60%
作業六取五 配法為 25%*1, 20%*3, 15%*1
小考五取四 都是25%
(都是取高的來算,分數高的都會優先分配到比例高的)
雖然有兩次小考不知道成績,
但依照已有的成績來推算的話得到的結論是沒有調分(或者頂多調了一分)
¥其他¥(是否注重出席率or嚴禁遲到?需要的基礎?)
不點名,但有小考(基本上都是教完一章就考,但後期會公告提醒)
小考可開書,有時候還會公開討論xD
而且到後期小考的題型會和大考的越來越像
基礎大概就是最基本的verilog了,因為作業要用verilog來寫
不過為什麼說最基本的就可以了呢?
因為事實上作業幾乎只要把各個module間的線按照spec裡寫的接起來就ok了
連數電實驗修得亂七八糟東倒西歪根本就不知道怎麼過的原PO都可以寫得出來~
作業的內容如下:
1st 組語(MIPS)
2nd ALU & Shifter
3rd & 4th Single Cycle CPU
5th & 6th Pipeline CPU
除了第五次要把 single cycle CPU 改成 pipeline CPU 很麻煩以外其它都還好,
數電爛爛的原PO大概在三~六個小時內都能寫好(反正就是照著spec無腦接線)
作業的時限都是兩或三個禮拜(大多是兩個)
而且好像都沒有奇奇怪怪的測資,算好拿分
¢最後想說的話¢
說真的,個人認為考試都不算難,到後面小考和大考的題型也都很像,
但考出來平均不知道為什麼都只有60出頭……(老師似乎也很疑惑xD
另外個人認為作業的配分太少了,
六個作業結果只有20分,非常不划算
(還只有取五次,而且取五次是在原PO寫完第六個不久後才說,QQ)
還有,老師好像預設大家都修過OS了(實際上則不一定),
所以有些與OS重疊的地方(mainly in ch5)就都會說"大家OS都上過了所以就不多講囉"
不過在看到大家一臉茫然的表情之後都還是會稍微再講一下就是了xD
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1F:推 perry0313: 其實點了一次名…不知實際用途 07/01 01:23
感謝補充,不過我記得這堂課我幾乎沒蹺啊,有這麼剛好嗎0.0(還是我忘掉了-3-)
※ 編輯: jo4fu3p (114.44.87.186), 07/13/2017 14:00:16