作者sooge (喜歡平井桃)
看板Grad-ProbAsk
標題[理工] 計組 single cycle和Multi-cycle
時間Mon Dec 10 20:20:08 2018
https://i.imgur.com/CBiXgtM.jpg
這題選擇是要選敘述對的
我要問C選項為什麼對? 不是multi-cycle更接近pipeline嗎？為什single cycle可以促進
管線化的設計?
https://i.imgur.com/igHUdbU.jpg
第20題請問d選項為什麼不對?
multi-cycle不是比single cycle更有效率嗎？
麻煩大家解答了
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1F：→ DLHZ: single cycle只說一個cycle內完成 但是cycle多少也不能確定12/10 20:29
2F：→ DLHZ: 效率 而且single cycle的clock還必須選是執行時間最長的12/10 20:29
3F：→ DLHZ: 我後面那句多餘了12/10 20:30
4F：→ DLHZ: 比如一個工作分成2個部分一個只要1ms但另一個要2ms 那這時候12/10 20:48
5F：→ DLHZ: 本來只要3ms的變4ms 所以multi或single並不能保證哪個比較好12/10 20:48
瞭解了 感謝!!
6F：→ DLHZ: 我聽ocw是有聽到single cycle的data path跟control在pipelin12/10 22:12
7F：→ DLHZ: e都會用到 不過原因是不是這個我不確定12/10 22:12
8F：推 nannnnn: 第二題 multicycle不是永遠都比single cycle好，因為mul12/10 23:26
9F：→ nannnnn: ticycle如果stage切的不夠好反而會比single cyxle爛12/10 23:26
忘了還有切不好的因素在 感謝回答!!
10F：推 ncdonalds123: 第一題是不是指 因為以前是single cycle所以才會開12/10 23:28
11F：→ ncdonalds123: 始設計pipeline，雖然我也覺得multi比較合理... 12/10 23:28
12F：→ nannnnn: 我在想第一題會不會是因為pipeline的硬體圖跟single cyc12/10 23:40
13F：→ nannnnn: le的很像12/10 23:40
14F：推 ChunagMT: 第一題老師說pipeline只是single的電路加pipeline regis12/11 08:21
15F：→ ChunagMT: ter還有一點點電路的改變 但multiple跟pipeline電路差很12/11 08:21
16F：→ ChunagMT: 多 課本最後的附錄好像有multi的電路12/11 08:21
對欸 我沒有想到其實single cycle和pipeline的硬體相近 謝謝各位大大解答
※ 編輯: sooge (125.231.43.188), 12/11/2018 09:25:27
17F：推 magic83v: 請問第一題的d為什麼會對 12/12 21:33
18F：推 magic83v: 和第二題的c register file lw跟R指令不就用了兩次嗎 12/12 21:35
19F：推 shawei: 我也想問第2題的c選項 理由同樓上 12/25 20:54