作者gecer (gecer)
看板Electronics
標題[問題] verilog 語法問題
時間Sun Mar 1 18:16:16 2020
wire cnt_kx_max_f = cnt_kx == KERNEL_SIZEX-1;
請問這裡 "==" 的意思
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1F：→ ggyyd: 就相等ㄚ 03/01 21:03
2F：推 weizhe: 當cnt_kx相等於KERNEL_SIZEX-1時，cnt_kx_max_f拉為1 03/02 11:33