作者like64cat (catliker)
標題Re: [問題] CMOS Switch
時間Sat Jul 22 15:24:03 2017
試試看在V(out)加一電阻loading到地.clk及v(in)波形不變.
※ 引述《was336789 (Howard)》之銘言：
: 標題: [問題] CMOS Switch
: 時間: Thu Jun 22 01:36:35 2017
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: 大家好，有個cmos switch的問題想請教大家。在clk=high的時候導通，在clk=low的時候
: 不導通。但模擬出來的結果，clk=high確實導通，但clk=low時(紅色)輸出的結果卻很奇
: 怪，非導通也非不導通。如果是導通那應該輸出的訊號會如同輸入的，如果是不導通，那
: 應該為0。可是我的輸出結果在clk=low時卻得到一個值。想請問這個CMOS Switch是哪個
: 地方錯了?謝謝大家。Vdd=1.8V
: http://i.imgur.com/RpoNKWr.jpg
: http://i.imgur.com/4hWPmyS.jpg
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: ※ 編輯: was336789 (195.37.177.70), 06/22/2017 01:37:18
: 推 mmonkeyboyy: 那是x 06/22 03:51
: → was336789: 抱歉，我不太懂x是什麼意思，可以麻煩你解釋嗎？謝謝 06/22 07:04
: → mmonkeyboyy: X我自己也打錯 @_@~ 手殘 那個是Z值啊 06/22 07:07
: 推 mmonkeyboyy: 你再仔細想想一下mos模型 你把它關了 他還剩什麼? 06/22 07:11
: 推 mmonkeyboyy: http://tinyurl.com/y8e8fosu 06/22 07:17
: 推 mmonkeyboyy: 你out沒有接東西 就像是有無限大電阻 06/22 07:21
: → mmonkeyboyy: 那左右都是無限大電阻 就...訊號就維持 或是慢慢變 06/22 07:21
: 推 corydoras09: 沒有接地吧？ 06/22 12:26
: 推 mmonkeyboyy: 樓上您就直接告訴答案了XD 06/22 16:46
: 推 joshhuang100: 不導通的時候是floating喔 06/22 18:48
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