作者god80306 (god80306)
看板Electronics
標題[問題] Verilog 2維陣列龐大到合成不出來
時間Sat Nov 19 13:31:59 2016
各位先進好，小弟碰FPGA和verilog才半年
最近要收一個image sensor的資料，
一個pixel有10bit，共有752*480個點的資料
以16*16的大小去模擬我的想法確實可以成功
但在做752*480的時候Quartus II合成兩小時還做不完...
有沒有前輩有關於這部分的經驗呢？
我是reg [9:0] Data [751:0] [479:0]
並做兩個counter一個數x座標一個數y座標
在sensor打clock過來時我latch資料到當下的 Data［x_counter］［y_counter］
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※ 編輯: god80306 (223.136.186.54), 11/19/2016 13:39:39
※ 編輯: god80306 (223.136.186.54), 11/19/2016 13:40:22
1F：推 Baneling: 應該要用memory吧？11/19 14:26
2F：推 Baneling: 應該要用memory吧？11/19 14:26
3F：推 shengyeh: 算一下就知道gate count夠不夠了吧11/19 14:52
4F：推 shengyeh: 如果不用sram 硬要用reg file的話11/19 14:58
5F：推 tzuwae: 合成兩小時是不是Quartus II當掉啊XD11/19 19:49
6F：→ amistad: 初步算一下fpga 內部 sram 夠不夠，不夠就用外部記憶體。11/19 20:02
7F：→ amistad: 初步算一下fpga 內部 sram 夠不夠，不夠就用外部記憶體。11/19 20:02
8F：→ amistad: 語法上可能不能用behavior 寫法，要改用 fpga 特用元件呼11/19 20:03
9F：→ amistad: 叫方式11/19 20:03
感謝各位前輩，後天到公司研究一下RAM怎麼存取再試試看
※ 編輯: god80306 (123.193.79.211), 11/19/2016 23:36:24
※ 編輯: god80306 (123.193.79.211), 11/19/2016 23:38:24
10F：→ furio: Quartus->tool->IPCatalog 可以叫出IPCatalog視窗 11/20 17:52
11F：→ furio: 再從視窗BasicFunction->OnChipMemory就可以叫出RAM功能 11/20 17:54
12F：→ furio: 不過像這種廠商自訂功能就無法考慮可移植性了 11/20 18:02
13F：推 mmonkeyboyy: 沒有人這種大MATRIX用合的啦 這合下去上頭不瘋了才怪 11/21 19:07
14F：→ mmonkeyboyy: SENSOR打過來時是放一個BUFFER轉到BRAM上去 11/21 19:08
15F：→ mmonkeyboyy: 你做一個ADDRESS DECODER 11/21 19:08
16F：→ mmonkeyboyy: 這種東西不用考慮可移植性 因為大家都知道要叫BRAM 11/21 19:09
17F：→ mmonkeyboyy: 這個SIZE不叫RAM 你買ultra系列都放不下去 11/21 19:11
18F：→ mmonkeyboyy: 這跟你碰VERILOG FPGA多久沒有關係這跟你有沒有好好 11/21 19:12
19F：→ mmonkeyboyy: 看使用手冊了解FPGA有關ALTERA 有本DUMMY FPGA去載來 11/21 19:12
20F：→ mmonkeyboyy: 看看 會幫助你更快了解使用FPGA 11/21 19:13
21F：推 furio: m大是好人不想讓原PO吃苦頭,那就看ug_vip.pdf這檔案 11/21 21:27
22F：→ furio: 這是altera推薦的影像處理架構 11/21 21:28
23F：推 hsucheng: FPGA可以合成二維陣列? 11/23 21:34
24F：→ hsucheng: 要用[18:0] 11/23 21:37
25F：推 luckyBF: 應該是FPGA 新手，整體概念還不熟的問題 11/26 19:25
26F：→ luckyBF: 我也好想回去玩FPGA.....進到廢渣系統廠就回不去了 11/26 19:26
27F：→ ahoyhoy: 這麼大一顆要掛block ram吧 10/23 18:09