作者ok456 (ooxx)
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標題[問題] LVS ERC database
時間Tue Nov 23 16:48:32 2010
最近在學layout
跑到LVS時
左邊ERC database一直有驚嘆號
分別是check NTap without Text ?VDD? ?VCC? ?VSS ?GND? EXCEPT DIODE and BJT
P
Report file是說 Error:Different numbers of ports
power or ground net missing
想請問一下layout是可能哪裡有問題呢?
spice檔我有先跑過
應該是對的
先謝謝各位了
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◆ From: 140.113.89.249
※ 編輯: ok456 來自: 140.113.89.249 (11/23 16:49)
1F：推 finalhaven:在LVS的檔裡面搜尋電源的名稱，拿掉那行註解 11/23 18:37
2F：→ ok456:您是說rule file嗎? 11/23 19:32
3F：→ ok456:是的話 可以說詳細一點嗎 謝謝 11/23 19:32
4F：推 finalhaven:對阿 就是Rule file，找出那行註解掉得電源名稱 11/23 19:41
5F：→ ok456:電源的名稱? 11/23 20:14
6F：→ ok456:VDDorGND? 11/23 20:14
7F：→ ok456:可以請問為什麼要這樣做嗎? 11/23 20:16
8F：→ ok456:因為照理說 我們demo作業 rule file應該不能改 11/23 20:17
9F：推 wait:將你Layout的 GND改成VSS VDD改成VCC就會不見了 11/23 21:55
10F：→ ok456:樓上 一樣耶...我spice檔也改了 11/23 22:06
11F：推 BuBuChen:你的layout上的pin layer對嗎? 11/23 22:21
12F：推 mos888tw:你該不會那個pin layer沒打準吧? 11/23 22:24
13F：→ ok456:兩位是指TEXT沒打準嗎? 11/23 23:08
14F：→ cpt:pin或label的問題 仔細檢查一遍吧 11/24 00:19
15F：→ ok456:不好意思 對layout還不熟 請問pin指的是?? 11/24 00:33
16F：→ kazamigai:確認這些地方對應到spice應該不是power＆gnd吧？ 11/24 00:53
17F：推 cpt:pin label port 基本上是類似的東西 不同製程套件可能會有不同 11/24 02:18
18F：→ cpt:定義 通常文件裡會說明 不然先簡單lay一個inverter測試一下吧 11/24 02:20
19F：推 Rencai:我也猜是Pin用錯layer或是用畫的而不是create的 11/24 10:41
20F：推 p5285070:我猜原PO是大三的?我最近也開始layout，一堆怪問題都會 11/25 00:29
21F：→ p5285070:發生，感覺還是到工作站問助教現場解決比較清楚 11/25 00:29
22F：→ ok456:謝謝各位 結果是layout有錯...= = 12/02 19:25