作者T3T (G.S.M.W)
看板comm_and_RF
标题Re: [请益] VNA如何port extension
时间Wed Jan 16 19:15:32 2019
1F：推 jandyforce: 推T大 简单来说做的时候跟你实际量测203.138.242.206 01/11 17:25
2F：→ jandyforce: 的状态要尽可能一样203.138.242.206 01/11 17:25
3F：→ jandyforce: 此外 这种扣法除了loss 相位才是最重203.138.242.206 01/11 17:26
4F：→ jandyforce: 要的 若是有RF线 也请注意该线材的203.138.242.206 01/11 17:26
5F：→ jandyforce: phase是否够稳定203.138.242.206 01/11 17:26
说到这个 有个Lesson Learnt分享一下
有次某个junior RD 简称阿菜好了
菜味扑鼻的那种 只差没理平头了
请他去量一下TX的performance
靠腰 Harmonic ACLR EVM都很鸟
我赶紧拿另一块验证 都很好啊
那就不会是是设计问题了 对吧?
因为设计问题 好比说Load-pull没调好
理论上应该大家一起死 不会单一板子GG
後来才发现 是他的RF Cable 俗称小黑线有问题
因为同一块板子 换了另一条小黑线量 性能都很好
现象跟着小黑线走 凶手是谁 这不是很明显?
原因就出在你说的 小黑线的Phase
很可能这条坏掉的小黑线
使得PA最终看出去的Phase歪掉了 也就是AM-PM偏了
影响Load-pull
这当然会影响TX性能
假设Block Diagram为
收发器 => PA => 双工器 => 天线开关
大家最常用的debug方式 就是一级一级验证
看问题是出在哪个Block
但大家都忽略了三个因素
Connector 小黑线 仪器
这三个才是你真正量测结果的终点站
天线开关 => Connector => 小黑线 => 仪器
任一个环节有问题 都会影响你最终结果
不是说你板子没事就OK
很多阿菜喔 一进来都雄心壮志啦
急急忙忙想赶快学怎麽debug
电源啦 Load-pull啦 Layout啦
却忽略了最重要的因素
『你的量测结果可以相信吗?』
如果这个先决条件没成立 後面都是做白工
你根据一个错误的量测结果 在那边分析
分析出来的结果也会是错的
我都常跟阿菜说
如果是True Fail 责任我扛 我来debug
我来被长官干到死
但如果是False Fail 是因为量测的错误
那我一定把你干到死
希望大家 尤其是阿菜们 不要忘记
Connector 小黑线 仪器
这三项的重要性
先确保你的量测结果正确再说
其余的自然有老鸟帮你扛
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标题 [闲聊] 喜欢女生的哪种内裤
6F：推 p_p_8_2_7_1:喜欢摸进去发现他也有老二的惊喜感
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