系 所：电子工程系 教 师：阮圣彰 必 选 修：选修 学 分：3 课程大概内容 Lecture_01 Computer Abstractions and Technology Lecture_02 Instructions: Language of the Computer Lecture_03_04 The Processor Lecture_05 Large and Fast:Exploiting Memory Hierarchy 上课用书 Computer Organization and Design RISC-V Edition: The Hardware Software Interface David Patterson and John Hennessy, 2017 上课方式 使用投影片上课，老师会讲解一些处理器的设计重点，非常强调设计上的观念，例如:这 里为什麽要这样设计等等 而太细节的部分老师不会细说，老师非常喜欢将设计上的一些概念与生活中的例子结合 个人觉得这样的方式确实是满好帮助理解，而且会比较印象深刻 评分方式 Homework两次: 40% Midterm Exam: 30% Final Exam: 30% 作业 总共有两次作业，都是与Verilog相关的 第一次是实作single cycle，第二次则是pipeline 但是其实不用太害怕，因为大部分的程式是助教已经写好的， 我们只需要将空缺的程式码补上就可以了，虽然作业刚发下来的时候乍看之下会觉得很复 杂 但是一步一步慢慢完成後就会发现没有这麽困难 听到有些学弟因为作业做不出来而二退其实满可惜的 而这学期我觉得很棒的是，助教很有耐心的解释作业 每个礼拜二五晚上也都会待在电脑教室，作业如果有任何问题都可以过去问 所以就算verilog基础不好也是没问题的 考试 期中期末考大概都只有10题，考试方式跟上课内容相关，可是论述的观念题 例如:CISC与RISC的差别，为什麽pipeline不能一直切下去越多级越好 为什麽cpu开始朝多核心发展，为什麽要设计I-type指令(immediate) 答题的关键就是要写到老师的点，有时候你觉得有回答到问题 但是老师觉得重要的点没写到的话，可能就会酌量扣分 有时候写太少没写到重要的点-------->扣分 有时候写太多不小心写了错的概念---->扣分 所以其实考卷没有很好写xd 基本上大家都是整面写好写满 顺带一提，因为考试是考观念，所以非常建议大家来上课， 如果翘课的话就算之後自己看投影片也可能不知道重点观念在哪 加上老师上课偶尔会泄题，说这边很重要一定会考什麽的 但是也有可能是骗人的，像是他强调了好几次如何一次解决3种Hazard 结果根本没考xd 总结 考师我觉得是电子系少数讲课讲得很清楚的老师 上课也常常会分享一些研究生或是业界的资讯 这学期也安排了3次业师课 依序是晶心科技、intel、ARM 因此也会额外的了解这堂课对於未来职场上的帮助 算是非常用心的 但是因为有些太细节的部份不会说，所以对於有要考研究所计算机组织的 可能帮助会没那麽大，可以搭配看清大黄婷婷老师的ocw 讲的非常清楚，两边一起学习的话效果会更好 成绩分布： A+ 8人(20%) A 3人(7.5%) A- 6人(15%) B+ 2人(5%) 私心推荐指数(以五分计)★★★★★ 想要了解计算机组织与计算机结构的差别 ★*10 想要了解CPU怎麽设计的 ★*10 想要了解什麽是停车场分配与早餐店点餐问题 ★*10 想要修完之後研究所考试考满分 ★*2 不喜欢早8，没睡到中午会浑身不舒服 ★*1 --

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