作者imadog (凹呜)
看板Grad-ProbAsk
标题[理工] 计组pipeline
时间Thu Dec 20 11:15:05 2018
在书上看到
pipeline可以increase the clock rate
有点不懂
每秒clock数会改变吗?我以为只是增加throughput
希望有大大能解释一下 谢谢><
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1F：推 chieya: clock cycle time 会降低@@ 12/20 11:28
2F：推 Aa841018: clock rate=1/cycle time, clock rate 高=cycle time低 12/20 11:38
3F：→ Aa841018: ，pipeline cycle time取决於最长步骤时间，所以pipelin 12/20 11:38
4F：→ Aa841018: e分割的越平衡，cycle time会越短 12/20 11:38
5F：→ Aa841018: ex:500--(250,250) &500-(1,499)，前者cycle time是250 12/20 11:38
6F：→ Aa841018: ，後者就变成499 12/20 11:38
7F：推 b10007034: 建议你思考一下为何增加？跟谁比较？ 12/20 11:53
8F：→ imadog: 谢谢楼上的解释，那我想再问一下，以A大的举例 如果不做p 12/20 12:13
9F：→ imadog: ipeline的话cycle time是500吗? 12/20 12:13
10F：推 Aa841018: 应该是，可以参考p436例题 12/20 12:29
11F：→ imadog: 好喔谢谢! 12/20 13:13