作者darksoul8507 (soul)
看板Electronics
标题[问题] 关於ALDO的稳定度
时间Thu Sep 1 15:39:08 2022
各位前辈大家好，
小弟现在想要设计一颗类比的LDO，
内部的op我是使用two stage的
（第一级是电流镜当主动负载的5T放大器，
第二级是使用classA的方式，做法参考Allen大师写的类比书）
这颗op有跑过ac模拟确定phase margin有大於60度，
接成unity gain buffer也是可以正常运作的，
但是我在op输出端接上一颗很大的power pmos，
并在pmos的drain端接上回授电阻串、输出电容（1uF）以及负载电流源（数十mA等级），
并且因为我的power mos选用pmos，
所以我要将参考电压接在op负输入端，
回授电压接在op正输入端。
在模拟结果图显示：
初始负载无论是重载或是无载都是有达到我想要的LDO输出电压，
然後一旦切换负载（无论负载多少、也不论是轻转重亦或是重转轻），
输出电压就会开始振荡，
并且愈振愈大，
看来就是不稳定的现象，
应该这个LDO是正回授的模式了。
这里想要请教各位，
请问有关於这个现象能给小弟一些意见吗？
或是可否告知小弟可以去哪里看一些误差放大器的设计以及LDO的补偿方式的讲解呢？
现在我找到的几乎都比较偏向大block层面的资料，
似乎比较少讲内部误差放大器的设计亦或是LDO的波德图要怎麽求...
手机排版请见谅
感谢各位前辈的意见
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1F：→ samm3320: 你这样是3 pole系统 09/01 15:46
2F：→ samm3320: 跑bode图要把整个loop都放进来，包含你的power pmos跟lo 09/01 15:47
3F：→ samm3320: ad 09/01 15:47
4F：→ samm3320: 单跑前级op的pm是没有意义的 09/01 15:49
5F：→ darksoul8507: s大您好，那这样请问我模拟整个ldo应该是将ac=1这 09/01 15:56
6F：→ darksoul8507: 行指令放在vref，然後vdb和vp(LDO的输出点)这样吗 09/01 15:56
7F：→ samm3320: 如果你是uni-gain是这样没错 09/01 16:05
8F：→ samm3320: 但没有特别需求不要去玩3p，很难调 09/01 16:06
9F：→ samm3320: 一般LDO前级就一个单级OTA而已 09/01 16:07
10F：→ samm3320: 如果你有电阻分压调整gain，那你要去看分压拉回去那个点 09/01 16:10
11F：→ darksoul8507: 感谢s大，那我就直接使用5T放大器输出直接接powermo 09/01 16:14
12F：→ darksoul8507: s的架构好了 09/01 16:14
13F：→ cebelas: 没有特殊需求, 第一级folded-cascode, 然後过follower 09/01 23:49
14F：→ cebelas: 给power mos 就好, 然後pwrmos gate端做light load clamp 09/01 23:49
15F：→ cebelas: 你output cap. 如果是cermic 记得考虑derating 09/01 23:51
16F：→ cebelas: 然後esr, esl会limit psrr 09/01 23:51
17F：→ cebelas: 找陈科宏, rincon mora的书看一看大概就会惹 09/01 23:52
18F：→ blacktea5: 楼上专业 09/02 09:20
19F：→ blacktea5: 要加 cascade compensation cc 09/02 09:21
20F：→ darksoul8507: 非常感谢c大和b大的回覆，现在会去找mora的类比LDO 09/02 13:31
21F：→ darksoul8507: 书来看 09/02 13:31
22F：→ darksoul8507: 想确定一下follower是指common drain电路吗 09/02 13:33
23F：→ blacktea5: 是的 09/02 14:04
24F：→ darksoul8507: 好的，非常感谢，如果之後有其他问题再请各位赐教 09/02 14:14