作者Baneling (爆炸一哥)
看板Electronics
标题Re: [问题] design compiler
时间Tue Oct 9 00:36:52 2018
※ 引述《eamansf96xs (草爷)》之铭言：
: 想请问
: set driving cell 该怎麽设
: 以及它和set input transition
: set clock transition. 的关系
: 搞不太懂
: 麻烦有经验的可否告知一下
看你的问法应该是连tool怎麽去算gate delay都不太清楚...
简单的说要算一个gate的delay需要它的input transition以及output load(电容)
set driving cell是指定你的input为固定的cell
让tool自己决定这一个gate的input transition
会这样用通常是设计整合型IP，有其它IP会推你的IP或者I/O PAD会推你的IP
如果要用set input transition，通常是单一IP设计，设定这个条件之後
如果其他人要用你的IP就必须把输出的transition设定好，这样接在一起timing才会过
又或者是你量晶片的仪器本身transition就是固定的... 如果是做包含PAD的Design
有时候的确需要用到这个指令(因为要让Tool去估算I/O PAD的delay)。
set clock transition... 也是一样的道理，要看你的clock source是啥
如果是仪器那就看仪器规格，如果是PLL/DLL或者晶体震荡器这种hard marco
就看电路的输出规格。
至於这个指令会有什麽影响.... 对你整条clock tree都会有影响呀
你的clock会影响timing path的skew计算，DFF的setup/hold time...等等
现在CIC我记得有开一门课，就把你抓过去几个星期，训练到你可以把一颗数位IC做出来
如果是学生的话就去上一上吧... 跟外面的单位比起来这价格算不贵了
花这笔钱真的比你自己瞎摸然後下线不会动要来的划算吧... XD
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1F：推 eamansf96xs: 感谢b大 有上过了 只是过很久有点忘了.... 10/09 00:54
2F：推 eamansf96xs: 相信这问题应该也有很多人不知道 感谢您的解答 10/09 00:59
3F：推 mmonkeyboyy: 这几个算是做SYSTEM一定会有的 不然下线会GG 10/09 01:26
4F：→ mmonkeyboyy: 我只能推这篇文主的第一句话了XD 10/09 01:28
5F：→ eamansf96xs: 这篇直接讲到重点 10/09 01:41
6F：→ eamansf96xs: 解惑一点就通 10/09 01:43
7F：推 mmonkeyboyy: 因为他解惑了你不懂的原理 而我认为你应该懂的 10/09 01:45
8F：→ mmonkeyboyy: 要不然正常工程师看到基准和arbitrary还不懂的话我就 10/09 01:46
9F：→ mmonkeyboyy: 只能先跪了 10/09 01:47
10F：→ mmonkeyboyy: 因为这个就是你问的那三个东西的最大差别和用法 10/09 01:47
11F：推 mmonkeyboyy: 外面上课好贵的 台湾有CIC好幸福的 10/09 01:51
12F：→ mmonkeyboyy: 这种课在很多地方都是喷掉上千美金最少 10/09 01:53