作者eamansf96xs (草爷)
看板Electronics
标题[问题] RTL 与 gatelevel 的 模拟
时间Tue Apr 10 20:02:16 2018
想请问一下 两者在相同tb下模拟
RTL会过 经DC合成完就不会过了
我的状况是要读100笔资料
合成完的电路只会读到99笔
时脉已经确定过很多次了
但是就是少一笔
有人有遇过这种状况吗？
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1F：推 mmonkeyboyy: gatelevel 那里来的? 手刻? 04/10 20:55
2F：→ mmonkeyboyy: 把一些optimization先注掉跑 04/10 20:56
3F：→ mmonkeyboyy: 应该是有timing问题 前端要先有个rst 04/10 20:58
4F：→ eamansf96xs: 跑dc变成gatelevel netlist 04/10 21:02
5F：→ eamansf96xs: 可是我是拿比赛题目给的.sdc去跑耶 04/10 21:03
6F：→ eamansf96xs: 都有rst. 了 04/10 21:04
7F：→ eamansf96xs: report timing. slack都正的 04/10 21:26
8F：推 amistad: RTL 的 non-blocking assignment 加 delay 试试看 04/10 21:37
9F：→ eamansf96xs: 在rtl code 加delay. dc不是不会理会吗？ 04/10 22:06
10F：→ eamansf96xs: 在code上加delay只是方便自己测试 04/10 22:07
11F：→ eamansf96xs: 实际电路不会因为你加delay他就帮你合delay. 我记得 04/10 22:07
12F：→ eamansf96xs: 是这样 04/10 22:07
13F：推 kuoll: 个人经验 八成是tb有问题 检查一下资料怎麽灌的 灌完第1笔 04/10 22:39
14F：→ kuoll: 後满足什麽条件才会灌第2笔？ 同理灌完第99笔後满足什麽条 04/10 22:39
15F：→ kuoll: 件才会灌第100笔? 条件满足了吗？ 04/10 22:40
16F：→ eamansf96xs: 但rtl模拟有过欸 这样还是tb问题？ 04/10 22:49
17F：→ eamansf96xs: 我做的是cic竞赛的东西 tb应该不会有问题吧 04/10 23:14
18F：→ eamansf96xs: 抱歉 以解决 刚刚看了rtl code根本不会有我预期的 04/10 23:42
19F：→ eamansf96xs: 结果 但跑tb却过了。。。 04/10 23:42
20F：→ eamansf96xs: 改了一下 合成完也能过了 04/10 23:42
21F：推 kuoll: tb不一定算无遗策 有些极端的pattern反而纠不出错 大胆怀 04/11 01:00
22F：→ kuoll: 疑小心debug才是正确态度 04/11 01:00
23F：推 mmonkeyboyy: ......跑tb却过了XD 太神奇了XD 04/11 02:07
24F：→ eamansf96xs: 了解 感谢各位帮助 04/11 08:19
25F：→ mmonkeyboyy: 哈 没帮上什麽忙 只觉得这个太神奇了orz 04/11 12:30
26F：→ mmonkeyboyy: 实际电路加delaY没有用btw 04/11 12:31
27F：→ mmonkeyboyy: 那些是non-sythesizable 04/11 12:31