作者shajoe (CMS)
站内Electronics
标题[问题] 关於RF_CMOS的Layout问题
时间Mon Aug 31 11:00:05 2009
※ [本文转录自 comm_and_RF 看板]
作者: shajoe (CMS) 站内: comm_and_RF
标题: [问题] 关於RF_CMOS的Layout问题
时间: Mon Aug 31 10:59:04 2009
不好意思，在这里想请教一下有在做RF_CMOS的
小弟目前有在制作高频PLL，但是数位部分的电
晶体不太确定是要用已有的台积Model还是自己
Layout？如是要自己Layout的话那要如何萃取
参数呢？<-----毕竟就算是数位部分频率也非常
高
希望有人能帮我解惑~谢谢
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◆ From: 140.113.28.223
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1F：推 deathcustom:你所谓的频率很高是多高？基本上FULL CUSTOM流程的话 08/31 11:36
2F：推 deathcustom:就是自己design, layout, rcx 08/31 11:37
3F：推 ilovecatch:查PDK 可以操作多高频 tsmc RF model 数位类比都有建 08/31 18:30
4F：→ ilovecatch:我觉得 最好不要自己画 08/31 18:30
5F：推 gyamwoo:推楼上，最好不要自己画…除非有必要的理由… 08/31 19:15
6F：推 pow:数位部分的电晶体自己萃取？不懂耶，到底是多快 08/31 21:05
7F：→ shajoe:因为我不太想除频除太多，所以频率有可能会落在1GHz左右 09/01 08:03
8F：→ shajoe:而之前看了满多的作品，它们除频器的交叉电路都自己画耶= = 09/01 08:04
9F：→ shajoe:所以想了解它们的参数是怎麽萃取到的 09/01 08:06
10F：推 ilovecatch:我想应该是跟跑post-sim一样 pex抽参数吧 09/01 17:22
11F：推 pow:你的意思是 不用standard cell而是自己画transistor layout吗 09/01 19:05
12F：推 pow:还有制程是什麽 09/01 19:13
13F：→ shajoe:TSMC 0.18um，transistor layout自己画 09/02 08:07
14F：→ shajoe:所以不会使用到standard cell~ 09/02 08:08
15F：→ shajoe:回上两层：可是之前读过模型的教材里面似乎有提到高频参数 09/02 08:10
16F：→ shajoe:使用Cadence来萃取似乎不准耶@@ 09/02 08:10
17F：推 deathcustom:可是他说1G左右的话应该很OK，教材中的高频是超过10G 09/02 10:45
18F：→ shajoe:所以说使用Cadence所萃取出来的模型在10GHz以下都可以使用? 09/02 14:50
19F：推 deathcustom:没有人说都可以啊～误差一定会有，是看你能忍受多少 09/02 16:02
20F：推 deathcustom:反正你除频器之後电晶体操作在1GHz的话应该没差很多 09/02 16:03
21F：→ shajoe:喔~明白罗，多谢各位的热心指导目前大概有个头绪了。 09/03 09:34