作者deathcustom ()
看板Electronics
标题Re: [问题]inverter
时间Mon Nov 10 15:58:21 2008
※ 引述《pdaer (NONE)》之铭言:
: ※ 引述《kj66 (秋天到来)》之铭言:
: : 请问一个反向器在transient response Vout是一个步阶信号
: : 可是讲义里有个模拟出来的结果,在一开始输出有个陡峭(短暂)的波形然後才开始下降
: : 信号在下降又要上升时又出现陡峭波形才开始上升
: : 请问为什麽会出现陡峭的波形呢?
: : 谢谢
: : ---
: : 有看了讲义,有说到是因为 caused by the gate-drain capacitances of the
: : inverter transistors.後面就看不太懂意思.
: 能不能解释成:
: Cgd两端,闸极从VOL拉到VOH,两端电压差瞬间相等,
: Steep Voltage视为极高频,Cgd瞬间短路,从Drain至Gate流过极大电流
: 而造成overshoot,这样不知道能不能解释这现象?
大家说的状况应该是像这样:
∕﹨﹏╴╴
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这个正式名称我没记错的话叫做glitch
的确加大Cl可以消除
不过,加大Cl同时会加大tp
最终导致电路整体操作速率下降
如果是在一般的数位电路的话glitch没有什麽太大的关系(阿Vh超过vdd有关系吗?)
( Vl低於gnd会怎样吗?)
重点在瞬间电流会不会烧掉metal/contact?
一般来讲,如果是作full-custom design、而且真的很在乎glitch影响的电路的部分
可以把整个操作看成下面这样
Cl = Cgs' + Cw,在local的状况下可以简单的看成Cgs'(也就是下一级的Cgs)
Cfb = Cgdn + Cgsp
然後视为一个一级OP的操作
去作适当调整(一般来说glitch会影响的通常是偏类比电路,如pll内部)
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◆ From: 122.116.95.114
1F:推 pow:这叫overshoot glitch定义不是这样拉 11/11 00:13
2F:→ pow:glitch比较像是 一个电路原本应该output一个值 11/11 00:16
3F:→ pow:结果他在输出那个正确值之前抖了一抖 :p 11/11 00:16
4F:→ pow:有很多digital gate、flip flop或者latch都有这种状况 11/11 00:17