作者jfsu (水精灵)
看板Electronics
标题Re: [问题] IC内部接地跟外部接地差在哪?
时间Wed Jul 30 11:52:57 2008
※ 引述《BlueFeel (蓝色感觉)》之铭言:
: 如果有一个IC
: 输出30MHZ的CLOCK讯号
: 如果它有一个PIN,里面是一个MOS,
: MOS开的时是HIGH,LOW时接地
: 那麽我一直让他LOW接地....
: 并且,layout从那个pin拉出来......与那30MHz靠很近
: 请问他会有隔离效果吗?
: 30MHz的crosstalk遇到一个低电位(mos接到地)讯号,
: 导到ic内的gnd会有什麽影响吗?
: 或者说......透过这mos接地......与直接接地........会差很多吗?
这种杂讯的隔离我有尝试过一次,如下所示
--------------- Gnd (logic '0')
▄▄▄▄▄▄▄▄ Signal
---------------- Gnd (logic '0')
上下两条ground的讯号在不动作是都是逻辑0。距离是最小的金属线宽(0.25um)
(它们是从一颗反相器出来的)
因为布局工程师的误解,以致於在不想改动太多的情况下,只好作这样的补救。
结果看起来,中间那条Signal的波型在示波器虽然有点脏,但至少没有失真的很严重。
可以让下一级的输入是正确接收到的。
基本上直接接到地会比较好,因为你不用再透过MOS,多一颗mos,杂讯会再多经由
一层well/junction,而且在这颗mos动作时,也会引入noise,这样隔离的效果变差
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