看板Electronics
标 题verilog问题
发信站清华资讯(枫桥驿站) (Sat Apr 8 01:35:53 2006)
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// The following will specify which library to bind to a sub-module (cell) within the design
config <config_name>;
design <lib_name>.<design_name>
default liblist <new_library_1> <library_2>;
cell <sub-module_name> use <new_library>.<new_module_name>;
endconfig;
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我不明白这个指令怎麽用
有没有人可以说明一下
并且用简单例子
我晓得这是用在模拟波型的testbench的程式用的,怎麽用或功能何在不太明白?
因为感觉是lib之类的东西说?.?
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