我在这里公布Final Project评分上大家需要take care一下的地方 (Approved by Ric) 假设你(你)已经写到自己预想的地方...可以参考一下这篇做最後的修改 反之如果code都还不能run的...那我强烈建议先按一下左键 先提醒一件最重要的事 : 明天deadline之後, 我们会立刻公布submission failed, compile error等等名单 请check你自己是否在list上, 并尽速补交到我们信箱[email protected] 原则上我们希望能在礼拜三开始帮大家run final project, 并做grading 所以请大家配合 !!! 我就先从大方向开始讲 : 1. 请大家务必在submission前通过selfcheck, 确定上传版本自己下载後正常 (拜托, 不要让助教们到project都还在帮大家改档名...) 2. 我们测一律在64 bit machine测, 每个testcase会分别评分, 但每个case下的 commands 会占不同分数, 好比cirsim在test1和test2里可能比重不同, 而 testcase 和以往作业一样由简单到困难 3. 我建议要做的command就要做到没问题 (robusity对program来说很重要) 由前几次作业可以知道只要testcase跑不完一定很低分 假设你很赶的写好strash, 但没有好好测导致会crash或timed-out, 有可能拿到比你strash整个没做还低的分数 !!! (depends on left commands) 4. 我们会用cirprint和cirgate来判断你们一些optimization或是simulation做对或错 所以请务必将这两个command做好 5. 对於output的format, 好比cirprint -netlist 我们都有预想一些地方你们可能和reference program output长得不一样 (e.g. 大小写, 空白和tab等等) 不过还是请尽量和reference program弄得像一点... 如果跑出来的output实在超过我们的想像, 只好请你(你)来和我们讨论一下 有些同学有问一些比较detail的测试, 我大致上提一下 1. 以circuit simplification类的command来说, 好比optimize, strash, ... 这些我们会以cirprint来看你们做对做错, 至於debug message不会评分 2. 对於cirsim, 我们会去看cirgate你们印出来的simulation value是否正确 另外当有pattern file时我们会去比对FEC是否都正确的抓出 同样的debug message是给你们自己看的, 不会用它来评分 3. 有些情形像cirsim -random + fraig, 可能每个人的结果都不尽相同 这部份会这样评分 : 1. fraig後cirprint的电路一定要和fraig前电路functionally equivalent 2. 如果fraig後电路被fraig掉的node相较於ref program少得太多, 会当 fraig没做 3. 如果fraig做太久, 也会当fraig做错 4. 每个testcase会设一个time out, 基本上最难的testcase也只会有10分钟 所以请balance一下cirsim -random和fraig的时间 (注意 : timed-out和crash是同一件事, 理论上10分钟是超级长的time limit) 5. 理论上project我们不会故意去测一些command上的errorOptions, e.g. Missing "" 也不会故意去测这方面的robusity 最後请缴交上来的档名取成 bxxxxxxxx_fraig.tgz, 当然untar後的资料夹必需是 bxxxxxxxx_fraig SelfCheck for Fraig Can be Downloaded from CEIBA. 想到再补...大家加油 !!! --

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